9进制是0~8，即0000~1000，只要在输出为1000时候，利用反馈清零，使计数器从0000开始重新计数。
连接方式：
EP＝ET＝＂1＂，
CLK端－＂cp＂，
D3D2D1D0端－＂0111＂，
RD端－＂1＂，
C端－非门－LD端。
状态图：shu0111－1000－1001－1010－1011－1100－1101－1110－1111－0111。
扩展资料：
1、如果按照计数器中的触发器是否同时翻转分类，可将计数器分为同步计数器和异步计数器两种。
2、如果按照计数过程中数字增减分类，又可将计数器分为加法计数器、减法计数器和可逆计数器，随时钟信号不断增加的为加法计数器，不断减少的为减法计数器，可增可减的叫做可逆计数器。
另外还有很多种分类不一一列举，但是最常用的是第一种分类，因为这种分类可以使人一目了然，知道这个计数器到底是什么触发方式，以便于设计者进行电路的设计。
参考资料来源：百度百科-计数器
9进制是0~8，即0000~1000，只要在输出为1000时候，利用反馈清零，使计数器从0000开始重新计数，电路如图
74LS161和门电路构成九进制计数器,要求写出设计过程,并列出状态转换表...
9进制是0~8，即0000~1000，只要在输出为1000时候，利用反馈清零，使计数器从0000开始重新计数。连接方式：EP＝ET＝＂1＂，CLK端－＂cp＂，D3D2D1D0端－＂0111＂，RD端－＂1＂，C端－非门－LD端。状态图：shu0111－1000－1001－1010－1011－1100－1101－1110－1111－0111。
如何使用74LS161和74LS00设计九进制计数器,跪求,详细点,谢谢
用74LS161和74LS00设计九进制计数器，就利用计数到9（即Q3Q2Q1Q0=1001）的状态产生一个复位信号，用Q3Q0的两个高电平经与非门74LS00输出复位信号。加到74LS161的MR（或叫CR）端，使计数器回0，实现改制。但9的状态是看不到的，最大数是8。下图就是逻辑图，也是仿真图，你可以不画数码管，...
电子技术基础(数字部分)74LS161计数功能实验
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试用同步加法计数器74LS161（或74LS160）和二4输入与非门74LS20构成百以内任意进制计数器，并采用LED数码管显示计数进制。采用555定时器构成多谐振荡电路，为同步加法计数器提供时钟输入信号。
用74161的异步清零和同步置数构成九进制计数器,起始状态为0100
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要实现六进制计数，可以利用74LS161这个16位加法计数器。通过置零法，当计数器状态从Q3Q2Q1Q0 = 0000变为0101时，会产生复位信号，使计数器回到初始状态0000。注意，74LS161实际上是一个16进制计数器，但我们可以通过调整置数和同步端的设置，将其转换为九进制计数器，其范围从5（最小值）到13（...
用74LS161组成十一进制计数器,求详细过程解答
利用74LS161本身的控制端（完成十进制，在达到1001（即十进制的九）时，给第二个芯片一个脉冲使第二个芯片计数加一，同时第一片清零，这样反复，直到第二片达到0110时第二片自身清零，这样完成一次60的计数，且回到初态，两片74LS161全部清零，继续重复计数。（1）同步计数器：实现是将计数脉冲引至...
数字钟设计
U1到U6 六个74LS161构成数字钟的秒、分、时计数器。 U1、U2共同构成秒计数器,它由两个74LS161构成六--十进制的计数器,如图四。U1作为秒个位十进制计数器,它的复位输入RD、和置位输入LD都接低电平,秒信号脉冲作为计数脉冲输入到CP1端,输出端C控制U2秒十位计数器的计数脉冲输入。Q1、Q2、Q3、Q4作为...
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常用门电路74系列器件
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